SoC Blockset
Concevoir, analyser et déployer des applications hardware/software pour les cartes SoC AMD et Intel
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SoC Blockset vous permet de simuler et d'analyser les performances de vos algorithmes sur des cartes SoC et ASIC programmables. Vous pouvez déployer ces algorithmes sous forme d'applications hardware et software pour le prototypage et la production.
Ce blockset vous permet de créer des modèles d'architectures hardware en définissant des interfaces entre les cœurs de processeur, la logique programmable, la mémoire et les périphériques. Vous pouvez utiliser les modèles pour partitionner les algorithmes entre la logique programmable et les processeurs afin d'analyser les compromis entre l'implémentation hardware et software. Ce blockset vous permet également de spécifier la planification des tâches des applications logicielles.
L'application SoC Builder automatise le déploiement en créant des cœurs IP et du software pour les cœurs Arm® et en programmant des cartes de développement depuis Simulink (avec HDL Coder et Embedded Coder).
SoC Blockset supporte l'analyse des applications déployées sur du hardware avec des outils de diagnostic de performance et de profilage logiciel. Parmi les dispositifs supportés figurent les SoC AMD® Zynq®-7000, les MPSoC/RFSoC Zynq UltraScale+, les SoC adaptatifs Versal™ et les SoC FGPA Intel®.
Effectuez une analyse préliminaire de votre design pour déterminer si les tâches logicielles de votre application peuvent être planifiées sur le hardware choisi. Commencez par une architecture fonctionnelle de l'application dans System Composer et allouez les composants fonctionnels aux processeurs ou à la logique programmable.
Analysez les designs des systèmes grâce aux modèles prédéfinis des dernières cartes SoC programmables de AMD, puis utilisez l'outil SoC Builder pour effectuer le déploiement et les tests sur les cartes de développement.
Documentation (Versal, RFSoC/MPSoC)
Exemples (Versal, RFSoC/MPSoC)
Avec Wireless HDL Toolbox, simulez et déployez un algorithme de récupération MIB 5G NR ou un algorithme de récupération SIB1 5G NR pour FR1 et FR2 avec une implémentation SoC Blockset ciblée sur les cartes RFSoC Zynq UltraScale+ de AMD.
Analysez les modèles Simulink ou les algorithmes MATLAB pour générer des rapports qui indiquent le nombre d'opérateurs arithmétiques requis pour l'implémentation. Utilisez ces rapports pour comparer différentes architectures pour les cartes FPGA, ASIC et SoC, évaluer les compromis de design et explorer les options de partitionnement hardware/software.
Modélisez la mémoire DDR et simulez les transactions de mémoire partagée entre la logique hardware et les processeurs embarqués. Configurez des contrôleurs DMA pour arbitrer le trafic mémoire. Prenez en compte la latence mémoire et le débit dans la simulation.
Modélisez l'exécution des tâches d'un software embarqué, comme gérées par le système d'exploitation (OS). Simulez les tâches avec un timing précis, en tenant compte des changements de contexte, de la préemption des tâches et de la durée d'exécution. Modélisez les interruptions du software générées par le FPGA. Utilisez les statistiques pour simuler des durées de tâche non-déterministes, ou exploitez les durées des tâches mesurées lors des tests du hardware.
Générez des designs de référence HDL Coder directement à partir de modèles SoC Blockset, puis utilisez l'outil HDL Workflow Advisor pour intégrer des cœurs IP créés avec HDL Coder.
Utilisez l'outil OS Customizer pour modifier et ajouter des bibliothèques à la distribution Linux® de votre processeur embarqué. Personnalisez le système d'exploitation Linux embarqué des cartes supportées.
Évaluez les applications radars, de vision et de communications tout en tenant compte des effets des sous-systèmes processeurs, FPGA et mémoire DDR. Implémentez des contrôleurs de moteur et d'électronique de puissance partitionnés entre les processeurs et la logique programmable.
Exemples (vision, communications, radar, contrôle moteur)